ディレイライン
クロック遅延ライン・ファミリに属する製品は、デジタル信号に一定の時間遅延を付加するためのデジタル回路であり、これによりデバイスの入力端子に印加された信号の遷移が、所定の時間経過後に出力端子で再現されます。これらは、高速デジタルシステムにおいて、異なる信号経路間での信号伝搬遅延のばらつきを補正または相殺するために広く用いられます。また、固定値、選択可能な値、あるいは可変値の遅延を生成するタイプのデバイスが提供されています。
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